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DS28CZ04: 4Kb I2C/SMBus EEPROM with Nonvolatile PIO
Figure 7. SRAM and PIO Writing
Memory Location
PIO Multi-Address Mode
PIO Single-Address Mode
Address
Function
SRAM Write
PIO Direct
SRAM Write
PIO Direct
00h to 77h
78h
79h
7Ah
7Bh
7Ch
7Dh
7Eh
7Fh
80h to FFh
00h to FFh
Memory
Reserved
Reserved
Register
Register
PIO R/W
PIO R/W
PIO R/W
PIO R/W
Memory
Memory
When writing to a PIO, as shown in Figure 8, any state change is triggered by the SCL pulse that the master
generates for the acknowledge bit of byte written to the PIO Read/Write Access Register. After the output transition
time t PV is expired, the state change is completed. In PIO Single-Address mode all PIOs change their state
approximately at the same time; in this mode the fastest rate for a PIO to change its state is f SCL /9. In PIO Multi-
Address Mode each PIO is accessed individually; in this mode when writing in an endless loop the fastest rate for a
PIO to change its state is f SCL /36. Transfer of data can be stopped at any moment by a STOP condition. When this
occurs, data present at the last acknowledged phase is valid.
Figure 8. PIO Write Access Timing
SRAM Write
SDA
MSB
(7Bh) data
LSB A MSB
DATA1
LSB A MSB
DATA2
LSB A MSB
DATA3
LSB A
SCL
t PV
PIO
PIO Direct
DATA1
DATA2
SDA
S A6 A5 A4 A3 A2 A1 P0 0
A MSB
PIO Address
LSB A MSB
DATA1
LSB A MSB
DATA2
LSB A
SCL
t PV
PIO
DATA1
Reading Memory and PIOs
If the DS28CZ04 is addressed in read access mode, the read pointer determines the location from which the
master will start reading. The read pointer is set when the DS28CZ04 is accessed in write access mode, either for
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